Abdessamad Houssaini
Digital Physical Design Engineering Intern @Arteris
Signup · Get unlimited contacts
WORK HISTORY
Digital Physical Design Engineering Intern @Arteris
Montigny-le-Bretonneux, FR
EDUCATION
Université Grenoble Alpes
Licence
Université Grenoble Alpes
Master
Ecole Supérieure de Technologie de Fès
Diplôme universitaire de technologie (DUT)
ABOUT ABDESSAMAD HOUSSAINI
Étudiant en Master Microélectronique et Intégration des Systèmes Temps Réels Embarqués (MISTRE) à l’Université Grenoble Alpes, je suis passionné par la conception numérique (ASIC/FPGA), les systèmes embarqués et l’intelligence artificielle appliquée à la microélectronique. Mes projets académiques et stages m’ont permis d’acquérir des compétences solides en :* Conception RTL, simulation, synthèse et implémentation FPGA* Développement embarqué sur STM32, PSoC, Raspberry Pi et Cortex A9* Traitement du signal, IA appliquée à l’analyse d’images SEM* Intégration HW/SW, validation et tests Lors de mon stage au CNRS – LTM, j’ai développé des algorithmes d’IA pour l’analyse d’images SEM bruitées, permettant l’automatisation de la détection de dislocations cristallines et contribuant à l’amélioration de la qualité des matériaux microélectroniques. Curieux, rigoureux et motivé, je suis actuellement à la recherche d’un stage de fin d’études (Février 2026, durée 5 à 6 mois) dans les domaines suivants :* Conception et vérification ASIC/FPGA (VHDL, Verilog, SystemVerilog)* Développement embarqué & temps réel (STM32, PSoC, RTOS)* Traitement du signal et IA embarquée* Électronique numérique et analogique avancée N’hésitez pas à me contacter pour échanger : h••••••••@gmail.com |+33•••••••11 Mobile en France | Permis B
This profile is compiled from publicly available professional sources. Unifers is not affiliated with or endorsed by LinkedIn. Request removal of this profile.